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在电子学中，通道晶体管逻辑 （PTL: pass transistor logic），描述了几个用于集成电路设计的逻辑家族 。它使用减少冗余晶体管的方法，减少了用于制作不同逻辑门的所需的晶体管数量。 晶体管作为开关用于导通电路节点之间逻辑电平，而不是作为与电压源直接连接的开关. 此减少了有源器件的数量, 但有一个缺点即输出电平可能不会再高于输入电平。每一个串联的晶体管使得输出电压低于输入电压。 如果几个器件在逻辑路径中串联，一般都需要一个传统的门去恢复信号电压到满值；而作为对比, 传统的CMOS逻辑总是作为电源轨道的晶体管开关，故逻辑电平在串联中不会减少。
既然因为输入信号与输出信号之间少了一些分隔，设计者必须注意评估一些意外的电路路径的影响。为了使设计正确工作，设计规则限制了电路的安排，所以可以避免一些隐蔽的路径、电荷分享、与低速的开关。 仿真的电路可能需要去保证足够的性能。
互补通道晶体管逻辑（CPL）或差分通道晶体管逻辑是具有某些优点的一个逻辑家族。它通常用于多路选择器与门闩.
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本表列出中华人民共和国福建省各级人民检察院。专门人民检察院见中华人民共和国检察院列表。
* 福建省福州市鼓山地区人民检察院（福建省福州市人民检察院派出机构）
* 福建省龙岩市青草盂地区人民检察院（福建省龙岩市人民检察院派出机构）
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尤霍·库斯蒂·巴锡基维芬兰总理、总统。他研究法律和历史，曾在赫尔辛基大学任教。后来经商。
1908年—1909年为内阁成员。当时芬兰是沙俄大帝国的一部分。当俄国对芬兰推行俄国化政策的时候，他退出了内阁。
1917年芬兰独立后，他在1918年出任芬兰第二任总理。在1938年—1939年的危机时期，他主张接受苏联的要求，努力使苏芬战争（1939年—1940年）很快结束。
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