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更新于 2026-10-07

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魏喜森(Ngwe Hee Sem,1月2日,别名阿森或Ah Sem)是马来西亚国阵马华公会马六甲州议会马接再也州议员和马六甲州政府团结、社会联系、人力资源及消费人事务委员会主席。他也是马华公会马六甲州联委会组织秘书和亚罗牙也区会副主席。

2021年马六甲州选举,魏喜森首次代表国阵马华公会上阵马接再也州议席,并在11月20日胜选。11月26日,魏喜森出任马六甲苏莱曼州政府团结、社会联系、人力资源及消费人事务委员会主席。

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求那跋陀罗译《众事分阿毘昙论》:「云何眼识?谓依眼根,行于色。云何耳识?谓依耳根,行于声。云何鼻识?谓依鼻根,行于香。云何舌识?谓依舌根,行于味。云何身识?谓依身根,行于触。云何意识?谓依意根,行于法。」

玄奘译《阿毘达磨法蕴足论》:「云何眼识界?谓眼色为缘,所生眼识,此中眼为增上,色为所缘,于眼所识色,诸了别,异了别,各别了别色,是名眼识界。」

玄奘译提婆设摩《阿毘达磨识身足论》:「契经中,世尊善语、善词、善说:『苾刍!了别,了别故名为识,何所了别?谓:了别色,了别声、香、味、触、法。』」

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在电子学中,通道晶体管逻辑 (PTL: pass transistor logic),描述了几个用于集成电路设计的逻辑家族 。它使用减少冗余晶体管的方法,减少了用于制作不同逻辑门的所需的晶体管数量。 晶体管作为开关用于导通电路节点之间逻辑电平,而不是作为与电压源直接连接的开关. 此减少了有源器件的数量, 但有一个缺点即输出电平可能不会再高于输入电平。每一个串联的晶体管使得输出电压低于输入电压。 如果几个器件在逻辑路径中串联,一般都需要一个传统的门去恢复信号电压到满值;而作为对比, 传统的CMOS逻辑总是作为电源轨道的晶体管开关,故逻辑电平在串联中不会减少。

既然因为输入信号与输出信号之间少了一些分隔,设计者必须注意评估一些意外的电路路径的影响。为了使设计正确工作,设计规则限制了电路的安排,所以可以避免一些隐蔽的路径、电荷分享、与低速的开关。 仿真的电路可能需要去保证足够的性能。

互补通道晶体管逻辑(CPL)或差分通道晶体管逻辑是具有某些优点的一个逻辑家族。它通常用于多路选择器与门闩.

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